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v100 v101 76 76 * [htdocs:cours/Archi-2-B4-cache-perf-2p.pdf Cours B4 : Impact des caches L1 sur les performances] 77 77 * [htdocs:cours/Archi-2-B5-threads-2p.pdf Cours B5 : Gestion simple des threads] 78 * [htdocs:cours/Archi-2-B6-alloc-2p.pdf Cours B6 : Allocateurs de mémoire dynamique] 78 79 {{{#!html 79 80 <p style="color:orange"><b><i>Les cours suivants sont en relecure :-)</i></b></p> 80 81 }}} 81 * [htdocs:cours/Archi-2-B6-alloc-2p.pdf Cours B6 : Allocateurs de mémoire dynamique]82 82 * [htdocs:cours/Archi-2-B7-synchro-2p.pdf Cours B7 : Mécanismes de synchronisation] 83 83 * [htdocs:cours/Archi-2-B8-initiateurs-2p.pdf Cours B8 : Périphériques initiateurs] … … 130 130 * [wiki:AS6-TME-B4 TME B4 : Impact des caches L1 sur les performances] 131 131 * [wiki:AS6-TME-B5 TME B5 : Gestionnaire de threads] 132 * [wiki:AS6-TME-B6 TME B6 : Allocateurs de mémoire dynamique] 132 133 {{{#!html 133 134 <p style="color:orange"><b><i>Les TME suivants sont en relecure :-)</i></b></p> 134 135 }}} 135 * [wiki:AS6-TME-B6 TME B6 : Allocateurs de mémoire dynamique]136 136 * [wiki:AS6-TME-B7 TME B7 : Mécanismes de synchronisation] 137 137 * [wiki:AS6-TME-B8 TME B8 : Périphériques Initiateurs]