source: trunk/Makefile.flags @ 112

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1) Stat_list : fix retire old and new register bug
2) Stat_list : remove read_counter and valid flag, because validation of destination is in retire step (not in commit step)
3) Model : add class Model (cf Morpheo.sim)
4) Allocation : alloc_interface_begin and alloc_interface_end to delete temporary array.
5) Script : add distexe.sh
6) Add Comparator, Multiplier, Divider. But this component are not implemented
7) Software : add Dhrystone
  • Property svn:keywords set to Id
File size: 1.8 KB
Line 
1#
2# $Id: Makefile.flags 112 2009-03-18 22:36:26Z rosiere $
3#
4# [ Description ]
5#
6
7#-----[ Simulator ]----------------------------------------
8SIMULATOR                       = systemcass
9
10# 3 simulators :
11# systemc                       - SystemC   
12# systemcass                    - SystemCASS
13# systemcass_deps               - Systemcass, and use port dependency information instead of sensitivity list
14
15#-----[ Flags ]--------------------------------------------
16MORPHEO_FLAGS                   =       -DSYSTEMC               \
17                                        -DDEBUG=DEBUG_TRACE     \
18                                        -DSTATISTICS            \
19                                        -DVHDL                  \
20                                        -DVHDL_TESTBENCH        \
21                                        -DTRANSLATION           
22
23#                                       -DVHDL_TESTBENCH_ASSERT \
24#                                       -DPRINT_COLOR           \
25#                                       -DPOSITION              \
26#                                       -DDEBUG_MEMORY_LEAK     \
27
28# Flags :
29# DEBUG={level}                               - Print Debug Message
30# SYSTEMC                                     - To generate a systemc's model
31# VHDL                                        - To generate a vhdl's    models
32# VHDL_TESTBENCH        (need SYSTEMC)        - In the simulation, generate two testbench's file (input and ouput) to validate the vhdl's model
33# VHDL_TESTBENCH_ASSERT (need VHDL_TESTBENCH) - In the simulation, generate in  testbench's file an serie of assert
34# POSITION                                    - To generate a position's files     (it's input of viewer)
35# STATISTICS            (need SYSTEMC)        - In the simulation, generate a statistics's file
36# INFORMATION           (need STATISTICS)     - Instance Information :
37#                                                 * Static    : at the instance creation
38#                                                    * register number
39#                                                    * worst way
40#                                                 * Dynamique : at the runtime
41#                                                    * consomation
42# TRANSLATION                                 - Translate message
43# PRINT_COLOR                                 - Print with colors
Note: See TracBrowser for help on using the repository browser.