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Cours Architecture des Systèmes Multi-Processeurs
- TME1 Protocole Pibus & prototypage virtuel
- TME2 Déploiement de code sur processeur programmable
- TME3 Architecture interne du contrôleur de caches L1
- TME4 Caractérisation et dimensionnement des caches
- TME5 Interruptions & communication avec les périphériques
- TME6 Contrôleur DMA
- TME7 Partage de périphériques / Prise de verrous
- TME8 Synchronisation et cohérence mémoire
- TME9 Mémoire virtuelle et MMU
- TME10 Partage du bus dans les architectures multi-processeurs
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