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Dec 8, 2009, 11:08:34 AM (15 years ago)

Author:

cobell

Comment:

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ToolsTp4-2010

@@ -137 +137 @@
 = 2 Routage manuel =
 
+Nous avons vu dans l'exercice précédent comment dessiner une cellule précaractérisée respectant le gabarit de le bibliothèque '''SXLIB'''. 
+Le but de cet exercice est de réaliser le dessin des masques d'un bloc combinatoire résultant de l'interconnexion de plusieurs cellules de la bibliothèque '''SXLIB'''.
+
+On va donc effectuer ''à la main'' (c'est à dire en utilisant l'éditeur interactif '''graal'''), le placement et le routage de cet opérateur, pour mieux comprendre les problèmes que doivent résoudre les outils de placement/routage automatiques.
+
+  == 2.1 Spécification fonctionnelle ==
+
 TODO
+
+Le bloc à réaliser contient donc 4 Full-adders.
+Regardons plus précisément les caractéristiques de cette cellule :
+
+  * La cellule a une largeur de x pitchs.
+  * Le signal d'entrée x est accessible sur x pistes de routage.
+  * Le signal de sortie x est accessible sur x pistes de routage.
+
+  == 2.2 Travail à réaliser ==
+
+  * Saisir sous '''graal''' le dessin du bloc ''adder'' en instanciant les 4 portes ''fulladder_x2''.
+  * Dessiner les fils de routage sous '''graal'''.
+  * Utiliser la commande ''equi'' pour vérifier la connectivité de chacun des signaux.
+  * Vérifier l'absence de violation des règles de dessin en lançant la commande ''druc'' sous '''graal'''.
+    Pour que cette vérification soit significative, il faut préalablement "mettre à plat" le bloc, en utilisant la commande ''real flat''.
+
+  * Extraire la netlist du bloc au format '''.al''' avec l'outil '''cougar''' mais sans descendre au niveau des transistors :
+    On veut obtenir une netlist de cellules, et non une netlist de transistors.
+  * Vérifier que la netlist obtenue ''adder.al'' et la netlist au format '.vst' obtenue au TP précédent sont isomorphes en utilisant l'outil '''lvx'''.
+  * Créer un fichier Makefile automatisant la procédure de validation.
 
 = 3 Placement de l'addaccu =