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| 2 | // File: tsar_mwmr_cluster.h |
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| 3 | // Author: Alain Greiner |
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| 4 | // Copyright: UPMC/LIP6 |
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| 5 | // Date : april 2013 |
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| 6 | // This program is released under the GNU public license |
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| 7 | ////////////////////////////////////////////////////////////////////////////// |
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| 8 | |
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| 9 | #ifndef SOCLIB_CABA_TSAR_MWMR_CLUSTER_H |
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| 10 | #define SOCLIB_CABA_TSAR_MWMR_CLUSTER_H |
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| 11 | |
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| 12 | #include <systemc> |
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| 13 | #include <sys/time.h> |
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| 14 | #include <iostream> |
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| 15 | #include <sstream> |
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| 16 | #include <cstdlib> |
|---|
| 17 | #include <cstdarg> |
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| 18 | |
|---|
| 19 | #include "gdbserver.h" |
|---|
| 20 | #include "mapping_table.h" |
|---|
| 21 | #include "mips32.h" |
|---|
| 22 | #include "vci_simple_ram.h" |
|---|
| 23 | #include "vci_xicu.h" |
|---|
| 24 | #include "vci_local_crossbar.h" |
|---|
| 25 | #include "dspin_local_crossbar.h" |
|---|
| 26 | #include "vci_dspin_initiator_wrapper.h" |
|---|
| 27 | #include "vci_dspin_target_wrapper.h" |
|---|
| 28 | #include "dspin_router.h" |
|---|
| 29 | #include "virtual_dspin_router.h" |
|---|
| 30 | #include "vci_mwmr_dma.h" |
|---|
| 31 | #include "vci_mem_cache.h" |
|---|
| 32 | #include "vci_cc_vcache_wrapper.h" |
|---|
| 33 | #include "vci_io_bridge.h" |
|---|
| 34 | #include "coproc_gcd.h" |
|---|
| 35 | #include "coproc_signals.h" |
|---|
| 36 | |
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| 37 | namespace soclib { namespace caba { |
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| 38 | |
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| 39 | /////////////////////////////////////////////////////////////////////////// |
|---|
| 40 | template<typename vci_param_int, |
|---|
| 41 | typename vci_param_ext, |
|---|
| 42 | size_t dspin_int_cmd_width, |
|---|
| 43 | size_t dspin_int_rsp_width, |
|---|
| 44 | size_t dspin_ram_cmd_width, |
|---|
| 45 | size_t dspin_ram_rsp_width> |
|---|
| 46 | class TsarMwmrCluster |
|---|
| 47 | /////////////////////////////////////////////////////////////////////////// |
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| 48 | : public soclib::caba::BaseModule |
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| 49 | { |
|---|
| 50 | |
|---|
| 51 | public: |
|---|
| 52 | |
|---|
| 53 | // Ports |
|---|
| 54 | sc_in<bool> p_clk; |
|---|
| 55 | sc_in<bool> p_resetn; |
|---|
| 56 | |
|---|
| 57 | // Thes two ports are used to connect IOB to IOX nework in top cell |
|---|
| 58 | soclib::caba::VciInitiator<vci_param_ext>* p_vci_iob_iox_ini; |
|---|
| 59 | soclib::caba::VciTarget<vci_param_ext>* p_vci_iob_iox_tgt; |
|---|
| 60 | |
|---|
| 61 | // These arrays of ports are used to connect the INT & RAM networks |
|---|
| 62 | soclib::caba::DspinOutput<dspin_int_cmd_width>** p_dspin_int_cmd_out; |
|---|
| 63 | soclib::caba::DspinInput<dspin_int_cmd_width>** p_dspin_int_cmd_in; |
|---|
| 64 | soclib::caba::DspinOutput<dspin_int_rsp_width>** p_dspin_int_rsp_out; |
|---|
| 65 | soclib::caba::DspinInput<dspin_int_rsp_width>** p_dspin_int_rsp_in; |
|---|
| 66 | |
|---|
| 67 | soclib::caba::DspinOutput<dspin_ram_cmd_width>* p_dspin_ram_cmd_out; |
|---|
| 68 | soclib::caba::DspinInput<dspin_ram_cmd_width>* p_dspin_ram_cmd_in; |
|---|
| 69 | soclib::caba::DspinOutput<dspin_ram_rsp_width>* p_dspin_ram_rsp_out; |
|---|
| 70 | soclib::caba::DspinInput<dspin_ram_rsp_width>* p_dspin_ram_rsp_in; |
|---|
| 71 | |
|---|
| 72 | // interrupt signals |
|---|
| 73 | sc_signal<bool> signal_false; |
|---|
| 74 | sc_signal<bool> signal_proc_it[16]; |
|---|
| 75 | sc_signal<bool> signal_irq_memc; |
|---|
| 76 | sc_signal<bool> signal_irq_mwmr; |
|---|
| 77 | |
|---|
| 78 | // Coprocessor signals |
|---|
| 79 | CoprocSignals<uint32_t,uint8_t> signal_to_coproc[8]; |
|---|
| 80 | CoprocSignals<uint32_t,uint8_t> signal_from_coproc[8]; |
|---|
| 81 | sc_signal<uint32_t> signal_config_coproc[8]; |
|---|
| 82 | sc_signal<uint32_t> signal_status_coproc[8]; |
|---|
| 83 | |
|---|
| 84 | // INT network DSPIN signals between DSPIN routers and DSPIN local_crossbars |
|---|
| 85 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_cmd_l2g_d; |
|---|
| 86 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_cmd_g2l_d; |
|---|
| 87 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_m2p_l2g_c; |
|---|
| 88 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_m2p_g2l_c; |
|---|
| 89 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_clack_l2g_c; |
|---|
| 90 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_clack_g2l_c; |
|---|
| 91 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_rsp_l2g_d; |
|---|
| 92 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_rsp_g2l_d; |
|---|
| 93 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_p2m_l2g_c; |
|---|
| 94 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_p2m_g2l_c; |
|---|
| 95 | |
|---|
| 96 | // INT network VCI signals between VCI components and VCI local crossbar |
|---|
| 97 | VciSignals<vci_param_int> signal_int_vci_ini_proc[8]; |
|---|
| 98 | VciSignals<vci_param_int> signal_int_vci_ini_mwmr; |
|---|
| 99 | VciSignals<vci_param_int> signal_int_vci_ini_iobx; |
|---|
| 100 | |
|---|
| 101 | VciSignals<vci_param_int> signal_int_vci_tgt_memc; |
|---|
| 102 | VciSignals<vci_param_int> signal_int_vci_tgt_xicu; |
|---|
| 103 | VciSignals<vci_param_int> signal_int_vci_tgt_mwmr; |
|---|
| 104 | VciSignals<vci_param_int> signal_int_vci_tgt_iobx; |
|---|
| 105 | |
|---|
| 106 | VciSignals<vci_param_int> signal_int_vci_l2g; |
|---|
| 107 | VciSignals<vci_param_int> signal_int_vci_g2l; |
|---|
| 108 | |
|---|
| 109 | // Coherence DSPIN signals between DSPIN local crossbars and CC components |
|---|
| 110 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_m2p_memc; |
|---|
| 111 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_clack_memc; |
|---|
| 112 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_p2m_memc; |
|---|
| 113 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_m2p_proc[8]; |
|---|
| 114 | DspinSignals<dspin_int_cmd_width> signal_int_dspin_clack_proc[8]; |
|---|
| 115 | DspinSignals<dspin_int_rsp_width> signal_int_dspin_p2m_proc[8]; |
|---|
| 116 | |
|---|
| 117 | // RAM network VCI signals between VCI components and VCI/DSPIN wrappers |
|---|
| 118 | VciSignals<vci_param_ext> signal_ram_vci_ini_memc; |
|---|
| 119 | VciSignals<vci_param_ext> signal_ram_vci_ini_iobx; |
|---|
| 120 | VciSignals<vci_param_ext> signal_ram_vci_tgt_xram; |
|---|
| 121 | |
|---|
| 122 | // RAM network DSPIN signals between VCI/DSPIN wrappers, RAM dspin crossbar |
|---|
| 123 | // and routers |
|---|
| 124 | DspinSignals<dspin_ram_cmd_width> signal_ram_dspin_cmd_xram_t; |
|---|
| 125 | DspinSignals<dspin_ram_rsp_width> signal_ram_dspin_rsp_xram_t; |
|---|
| 126 | DspinSignals<dspin_ram_cmd_width> signal_ram_dspin_cmd_memc_i; |
|---|
| 127 | DspinSignals<dspin_ram_rsp_width> signal_ram_dspin_rsp_memc_i; |
|---|
| 128 | DspinSignals<dspin_ram_cmd_width> signal_ram_dspin_cmd_iob_i; |
|---|
| 129 | DspinSignals<dspin_ram_rsp_width> signal_ram_dspin_rsp_iob_i; |
|---|
| 130 | DspinSignals<dspin_ram_cmd_width> signal_ram_dspin_cmd_xbar; |
|---|
| 131 | DspinSignals<dspin_ram_rsp_width> signal_ram_dspin_rsp_xbar; |
|---|
| 132 | DspinSignals<dspin_ram_cmd_width> signal_ram_dspin_cmd_false; |
|---|
| 133 | DspinSignals<dspin_ram_rsp_width> signal_ram_dspin_rsp_false; |
|---|
| 134 | |
|---|
| 135 | ////////////////////////////////////// |
|---|
| 136 | // Hardwate Components (pointers) |
|---|
| 137 | ////////////////////////////////////// |
|---|
| 138 | VciCcVCacheWrapper<vci_param_int, |
|---|
| 139 | dspin_int_cmd_width, |
|---|
| 140 | dspin_int_rsp_width, |
|---|
| 141 | GdbServer<Mips32ElIss> >* proc[8]; |
|---|
| 142 | |
|---|
| 143 | VciMemCache<vci_param_int, |
|---|
| 144 | vci_param_ext, |
|---|
| 145 | dspin_int_rsp_width, |
|---|
| 146 | dspin_int_cmd_width>* memc; |
|---|
| 147 | |
|---|
| 148 | VciDspinInitiatorWrapper<vci_param_ext, |
|---|
| 149 | dspin_ram_cmd_width, |
|---|
| 150 | dspin_ram_rsp_width>* memc_ram_wi; |
|---|
| 151 | |
|---|
| 152 | VciXicu<vci_param_int>* xicu; |
|---|
| 153 | |
|---|
| 154 | VciMwmrDma<vci_param_int>* mwmr; |
|---|
| 155 | |
|---|
| 156 | CoprocGcd* gcd; |
|---|
| 157 | |
|---|
| 158 | VciLocalCrossbar<vci_param_int>* int_xbar_d; |
|---|
| 159 | |
|---|
| 160 | VciDspinInitiatorWrapper<vci_param_int, |
|---|
| 161 | dspin_int_cmd_width, |
|---|
| 162 | dspin_int_rsp_width>* int_wi_gate_d; |
|---|
| 163 | |
|---|
| 164 | VciDspinTargetWrapper<vci_param_int, |
|---|
| 165 | dspin_int_cmd_width, |
|---|
| 166 | dspin_int_rsp_width>* int_wt_gate_d; |
|---|
| 167 | |
|---|
| 168 | DspinLocalCrossbar<dspin_int_cmd_width>* int_xbar_m2p_c; |
|---|
| 169 | DspinLocalCrossbar<dspin_int_rsp_width>* int_xbar_p2m_c; |
|---|
| 170 | DspinLocalCrossbar<dspin_int_cmd_width>* int_xbar_clack_c; |
|---|
| 171 | |
|---|
| 172 | VirtualDspinRouter<dspin_int_cmd_width>* int_router_cmd; |
|---|
| 173 | VirtualDspinRouter<dspin_int_rsp_width>* int_router_rsp; |
|---|
| 174 | |
|---|
| 175 | VciSimpleRam<vci_param_ext>* xram; |
|---|
| 176 | |
|---|
| 177 | VciDspinTargetWrapper<vci_param_ext, |
|---|
| 178 | dspin_ram_cmd_width, |
|---|
| 179 | dspin_ram_rsp_width>* xram_ram_wt; |
|---|
| 180 | |
|---|
| 181 | DspinRouter<dspin_ram_cmd_width>* ram_router_cmd; |
|---|
| 182 | DspinRouter<dspin_ram_rsp_width>* ram_router_rsp; |
|---|
| 183 | |
|---|
| 184 | DspinLocalCrossbar<dspin_ram_cmd_width>* ram_xbar_cmd; |
|---|
| 185 | DspinLocalCrossbar<dspin_ram_rsp_width>* ram_xbar_rsp; |
|---|
| 186 | |
|---|
| 187 | |
|---|
| 188 | // IO Network Components (not instanciated in all clusters) |
|---|
| 189 | |
|---|
| 190 | VciIoBridge<vci_param_int, |
|---|
| 191 | vci_param_ext>* iob; |
|---|
| 192 | |
|---|
| 193 | VciDspinInitiatorWrapper<vci_param_ext, |
|---|
| 194 | dspin_ram_cmd_width, |
|---|
| 195 | dspin_ram_rsp_width>* iob_ram_wi; |
|---|
| 196 | |
|---|
| 197 | // cluster constructor |
|---|
| 198 | TsarMwmrCluster(sc_module_name insname, |
|---|
| 199 | size_t nb_procs, |
|---|
| 200 | size_t x, // x coordinate |
|---|
| 201 | size_t y, // y coordinate |
|---|
| 202 | size_t xmax, |
|---|
| 203 | size_t ymax, |
|---|
| 204 | |
|---|
| 205 | const soclib::common::MappingTable &mt_int, |
|---|
| 206 | const soclib::common::MappingTable &mt_ext, |
|---|
| 207 | const soclib::common::MappingTable &mt_iox, |
|---|
| 208 | |
|---|
| 209 | size_t x_width, // x field bits |
|---|
| 210 | size_t y_width, // y field bits |
|---|
| 211 | size_t l_width, // l field bits |
|---|
| 212 | size_t p_width, // p field bits |
|---|
| 213 | |
|---|
| 214 | size_t int_memc_tgt_id, |
|---|
| 215 | size_t int_xicu_tgt_id, |
|---|
| 216 | size_t int_mwmr_tgt_id, |
|---|
| 217 | size_t int_iobx_tgt_id, |
|---|
| 218 | |
|---|
| 219 | size_t int_proc_ini_id, |
|---|
| 220 | size_t int_mwmr_ini_id, |
|---|
| 221 | size_t int_iobx_ini_id, |
|---|
| 222 | |
|---|
| 223 | size_t ram_xram_tgt_id, |
|---|
| 224 | size_t ram_memc_ini_id, |
|---|
| 225 | size_t ram_iobx_ini_id, |
|---|
| 226 | |
|---|
| 227 | bool is_io, |
|---|
| 228 | size_t iox_iobx_tgt_id, |
|---|
| 229 | size_t iox_iobx_ini_id, |
|---|
| 230 | |
|---|
| 231 | size_t memc_ways, |
|---|
| 232 | size_t memc_sets, |
|---|
| 233 | size_t l1_i_ways, |
|---|
| 234 | size_t l1_i_sets, |
|---|
| 235 | size_t l1_d_ways, |
|---|
| 236 | size_t l1_d_sets, |
|---|
| 237 | size_t xram_latency, |
|---|
| 238 | size_t xcu_nb_inputs, |
|---|
| 239 | |
|---|
| 240 | const Loader &loader, // loader for XRAM |
|---|
| 241 | |
|---|
| 242 | uint32_t frozen_cycles, |
|---|
| 243 | uint32_t start_debug_cycle, |
|---|
| 244 | bool memc_debug_ok, |
|---|
| 245 | bool proc_debug_ok, |
|---|
| 246 | bool iob0_debug_ok ); |
|---|
| 247 | |
|---|
| 248 | protected: |
|---|
| 249 | |
|---|
| 250 | SC_HAS_PROCESS(TsarMwmrCluster); |
|---|
| 251 | |
|---|
| 252 | void init(); |
|---|
| 253 | |
|---|
| 254 | |
|---|
| 255 | }; |
|---|
| 256 | |
|---|
| 257 | }} |
|---|
| 258 | |
|---|
| 259 | #endif |
|---|
| 260 | |
|---|
| 261 | // Local Variables: |
|---|
| 262 | // tab-width: 3 |
|---|
| 263 | // c-basic-offset: 3 |
|---|
| 264 | // c-file-offsets:((innamespace . 0)(inline-open . 0)) |
|---|
| 265 | // indent-tabs-mode: nil |
|---|
| 266 | // End: |
|---|
| 267 | |
|---|
| 268 | // vim: filetype=cpp:expandtab:shiftwidth=3:tabstop=3:softtabstop=3 |
|---|
| 269 | // |
|---|
