| 1 | .model tlc |
|---|
| 2 | .inputs in1 |
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| 3 | .inputs in2 |
|---|
| 4 | #.inputs in3 |
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| 5 | .outputs out11 |
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| 6 | .outputs out12 |
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| 7 | .outputs out13 |
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| 8 | .outputs out14 |
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| 9 | .outputs out15 |
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| 10 | .latch out1 in4 0 |
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| 12 | .latch out3 in6 0 |
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| 20 | .names in1 in1__ |
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|---|
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|---|
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|---|
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|---|
| 29 | 0 1 |
|---|
| 30 | .names in7 in7__ |
|---|
| 31 | 0 1 |
|---|
| 32 | #.names in8 in8__ |
|---|
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|---|
| 34 | .names in1__ in4__ in5__ in6__ in7 g_1and1 |
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| 35 | 11111 1 |
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| 36 | .names in1__ in4 in5 in6__ in7__ g_1and2 |
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| 39 | 11111 1 |
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| 40 | #.names in1__ in3 in8__ g_1and4 |
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| 42 | #.names in1__ in3__ in8 g_1and5 |
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| 172 | .end |
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