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Author:
anne
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    v1 v2  
    99On écrira la description compotementale de chacun des blocs :  '''muxe.vbe''', '''muxs.vbe''', '''alu.vbe''', '''accu.vbe''', '''ram.vbe'''
    1010 * Dans un deuxième temps , réaliser la description strcturelle d'un bloc en cellules standard de '' SXLIB''
     11== Exercices ==
     12=== Exercice 1- Ecriture du modèle structurel du coeur de l'AMD2901 ===
     13==== Question 1 ====
     14En partant du fichier amd_coeur.vbe écrivez le fichier muxe.vbe
     15==== Question 2 ====
     16En partant du fichier amd_coeur.vbe écrivez le fichier muxS.vbe
     17==== Question 3 ====
     18En partant du fichier amd_coeur.vbe écrivez le fichier alu.vbe
     19==== Question 4 ====
     20En partant du fichier amd_coeur.vbe écrivez le fichier accu.vbe
     21==== Question 5 ====
     22En partant du fichier amd_coeur.vbe écrivez le fichier ram.vbation
     23==== Question 6 ====
     24En vous inspirant du fichier amd_chip.py (voir TP7) qui correspond au découpage coeur-plots de l'AMD2901, écrivez le fichier amd_coeur.py correspondant à l'instanciation des 5 blocs muxe,muxs,alu,accu et ram puis éexécutez le par la commande :
     25{{{
     26>./amd_coeur.py
     27}}}
     28==== Question 7 ====
     29Pour pouvoir faire une simulation de amd_coeur.vst, que doit contenir le fichier CATAL ? pourquoi ?
     30
     31On effectuera une première simulation de amd_coeur.vst avec un fichier de pattren élémentaire, comme suit :
     32{{{
     33in vdd;
     34begin
     35<0 ns> : 1;
     36end;
     37}}}
     38==== Question 8 ====
     39Simulez la netlist obtenue dans son environnement (amd_2901_ctl) avec l'ensemble des fichiers de test que vous avez utilisé pour valider votre fichier amd_2901_dpt.vbe.
     40
     41=== Exercice 2-Ecriture du modèle structurel du multiplexeur d'entrée ===
     42Pour cet exercice nous allons prendre pour exemple la génération de l'entrée '''r''' de l''''alu'''