Changes between Version 23 and Version 24 of AS6-TME-B4
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AS6-TME-B4
v23 v24 45 45 }}} 46 46 47 Vous pouvez lire les [htdocs:cours/Archi-2-B5-cache-perf-2p.pdf slides de cours] pour voir les détails, mais voici le résumé des principes en quelques lignes. 47 48 {{{#!html 49 <font size=+7 color=orange> En travaux</font><br><br> 50 }}} 51 52 53 Vous pouvez lire les slides de cours pour voir les détails, mais voici le résumé des principes en quelques lignes. 48 54 49 55 Les caches L1 ont pour but d'améliorer les performances en réduisant le nombre de cycles nécessaires pour accéder à la mémoire à la fois pour les instructions que pour les données. Le tampon d'écriture, présent dans le cache mais qui n'est pas un cache, permet aussi de réduire la latence des écritures de données (elle est même nulle la plupart du temps).