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Architecture Logicielle et Matérielle des Ordinateurs (ALMO) - 3I004

Organisation 2018

​Site annuel du module ALMO sur le site de la licence

Cours
lundi 8h45-10h30 Amphi à définir Franck Wajsbürt
TD - TP
G1 lundi 10h45-15h45 TP Barre 24-25 Salle 302 Franck Wajsbürt
G2 lundi 16h00-19h45 TP Barre 14-15 salle 308 Alain Greiner
G3 mercredi 14h00-17h45 TP Barre 14-15 Salle 401 Quentin Meunier
G4 vendredi 14h00-17h45 TP Barre 14-15 Salle 301 ?
Cours TD/TP Interro
37 C0: Vue d'ensemble du module
38 C1: Asembleur MIPS TD1: Programmation Assembleur
TP1: Présentation XSPIM
39 C2: Utilisation de la pile & appels de fonctions TD2: Appels de fonctions
TP2: Programmation fonctions / XSP:IM
40 C3: Interruptions / Exceptions /Trappes + GCC TD3: Programme complet
TP3: Génération de code GCC / XSPIM
41 C4: Bus système et périphériques / GIET TD4: Architecture mono-processeur
TP4: Génération de code pour SoCLib 		Assemb
42 C5: Hiérarchie mémoire et techniques de cache TD5: Principe des mémoires cache
TP5: Effets de cache
43 C6: Caches (suite) Interrupts, exceptions, trappes TD6: Performances caches
TP6: Perfs caches 		Cache
(corrigée)
44 Vacances
45 Partiel corrigé
46 C7: Accès aux périphériques : ICU, TTY, TIMER TD7: Analyse GIET
TP7: Communications par interruptions 		Cache
47 C8: Périphériques DMA : contrôleurs disque et réseau TD8: Périphériques DMA
TP8: contrôleurs IOC, DMA et FB
48 C9: Multiplexage temporel & Commutation de tâches TD9: Commutation de tâches
TP9: Commutation de tâches 		Giet
49 C10: Principe Mémoire Virtuelle et MMU/TLB TD10: Partage du bus système
TP10: Architecture multi-processeur
50 C11: Programmation parallèle multi-tâches et synchro TD11: mémoire virtuelle
TP11: Rattrapage 		Switch
51 Révisions guidées
52 Vacances
1 Vacances
2 1ère Session

Sujets de TD

Sujets de TP

Documents

Documentation architecture matérielle

Annales d'examen