6 | | * [[Seance1|Séance 1 : TD – Rappels sur l'architecture du Mips]] |
7 | | * [[Seance2|Séance 2 : TME – VHDL – Environnement de simulation]] |
8 | | * [[Seance3|Séance 3 : TD – Pipeline MIPS]] |
9 | | * [[Seance4|Séance 4 : TD – Pipeline, Superpipeline, Optimisation de codes]] |
10 | | |
| 6 | * [[Seance1| Séance 1 : TD – Rappels sur l'architecture du Mips]] |
| 7 | * [[Seance2| Séance 2 : TME – VHDL – Environnement de simulation]] |
| 8 | * [[Seance3| Séance 3 : TD – Pipeline MIPS]] |
| 9 | * [[Seance4| Séance 4 : TD – Pipeline, Superpipeline, Optimisation de codes]] |
| 10 | * [[Seance5| Séance 5 : TD – Superscalaire, Optimisation de codes]] |